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差分晶振（功能性晶振）
差分晶振通過使用兩種相位彼此完全相反的信號，從而消除了共模噪聲，實現一個更高性能的系統。差分輸出波形有LVDS、LVPECL、HCSL等。差分屬于有源晶振，內部集成振蕩電路，外部供電即可直接輸出穩定的時鐘信號。
本質是一個被動元件，依賴外部電路（如MCU內部的振蕩器）驅動才能起振。需匹配負載電容和電阻才能穩定工作。
差分晶振一般6個PIN腳,測試電路如下圖：
 
 
無源晶振
兩引腳或四引腳封裝（無電源引腳）,需外接負載電容和匹配電阻。
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特性
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差分晶振
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無源晶振
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頻率穩定性
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高
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較低
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抗干擾能力
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極強（差分信號抑制共模噪聲）
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弱（單端信號易受干擾）
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相位噪聲
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低（適合高頻高精度場景）
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較高（依賴外部電路設計）
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啟動時間
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快
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較慢
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成本
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高
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低
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差分晶振：
高速通信（如FPGA、SerDes等）。
對EMI敏感的系統（如射頻、航空航天等）。
需要長距離傳輸時鐘信號的場景。
無源晶振：
低成本嵌入式系統（如STM32、51單片機）。
消費電子產品（如家電、玩具）。
對時鐘精度要求相對不高的場景。
信號類型：差分輸出 vs 單端輸出。
集成度：差分晶振內置振蕩器，無源晶振需外部電路驅動。
抗干擾：差分信號更適合高速、高噪聲環境。
設計復雜度：無源晶振需匹配電容/電阻，差分晶振即插即用。
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